タグ付けされた質問 「manufacturing」

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実装されていないコンポーネントをBOMに配置する理由
関係のないバックグラウンドからかなりの数のエンジニアに出会って、BOMに未実装のコンポーネントを配置しました。下部にDNPと明確にラベル付けされたセクションを行うものもあれば、BOM全体に分散させたままにする行もありますが、行を強調表示します。 これを行う必要がある場合は、DNPセクションを作成するのが良い方法のように思えますが、CADパッケージ出力をさらに手動で編集する必要があるという唯一の欠点があります。(個人的にこれを目撃しましたが、DNPは最後の最後に変更され、DNPセクションは適切に編集されず、ボード上にあるべきではない部分が配置されました。)移入された行と移入されなかった行が簡単に重複する可能性があり、さらに手動で編集する必要があります。 この練習が必要な理由がわかりません。定義によるBOMは、何かを構築するために必要なもののリストです。コンポーネントがBOMおよびアセンブリ図面上にない場合、ボード上にあるべきではありません。実際には存在しないコンポーネントを追加することは、BOMをERPに入力して購入する人にとっては、さらに混乱を招くように思えます。部品が入っていない部品をBOMに配置すると、部品をBOMおよびアセンブリ図面から除外しても何が達成されないのですか?

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「リスクウェーハ」とは何ですか?
集積回路の製造において、「通常の」ウェーハとは異なるように見える「リスクウェーハ」という用語に出会いました。しかし、私はリスクウェーハが実際に何であるかについてオンラインで情報を見つけることができません。

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ログテーパーポットが滑らかでないのはなぜですか?
Bテーパーポットは線形で、Aテーパーポットは「ログ」であり、ボリュームコントロールなどに使用されます。しかし、実際に指定されたテーパー、および私が測定したものは、滑らかな曲線ではなく、区分的に線形です。 これがなぜだろうか?完全に滑らかな曲線のポットを作るのがこれ以上難しいとは想像できません。

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なぜ希土類金属は電子工学にとって重要なのですか?
私はメディアで希土類金属の重要性について多くのことを聞いてきました(中国の輸出を制限する経済的観点から)シリコン、金、銅、アルミニウム、ゲルマニウムなどの一般的な要素?トランジスタなどのデジタルコンピュータのすべての構成要素は、それらなしで作成できるように思えますが、なぜすべての大騒ぎなのでしょうか? 私は記事のために少し掘り下げましたが、それらはすべて一般向けに書かれており、実際のコンポーネントではなくレアアースを必要とするデバイスのみを挙げています。

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PCB FabでのE-Tes​​tはどのように機能しますか?
PCBをファブハウスに送るときに、Eテストのオプションが常に表示されます。すべての接続をテストするための電気テストです。しかし、彼らはどうやってそれをするのでしょうか?彼らは私の回路図を持っていません!ガーバーだけ?そして、それは確かに機械によって行われますか?

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ファームウェアが実稼働環境で一意に識別されることは実用的ですか
大規模製造で利用可能なシステムがあり、一意のシリアル番号をファームウェアにプログラムしたり、PCBごとに空きメモリスペースをプログラムしたりできますか? 私のことを見つけたFDAは、医療グレードのデバイスのためにそれを強制開始することを決定しましたが、これは達成することは容易であるか、それはあなた自身の製造プロセスの開発が必要となるものですか?

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NAND / NORゲートのみを使用すると、回路遅延が増加しますか?
学校で、論理回路を論理ゲートNANDまたはNORゲートだけで構築できることを覚えています。 まず第一に、これが実際にどのように行われているのか疑問に思います。つまり、IntelがCPUを作成するとき、NAND/ NORgates を使用してすべてのレジスタなどを構築しますか? 第二に、この方法ですべてを構築すると、AND/ OR/ NOTゲートを使用して作成された回路と比較して伝播遅延が増加するのではないかと思っています。 私が使用しているときことを知っているPMOS/ NMOS、ビルドゲートに構成しANDたりORとは対照的に、2つの段階として出てくるNANDか、NORその両方のみ1である私はあなたが作ることができます知っているので、AND2カスケード接続からNANDSとOR2つのカスケード接続からNOR、それは、SメーカーがNANDsとNORsの両方を使用している限り、伝播遅延は増加しないようです。 特に製造されたICで実際に何が行われているのかについて、誰もがこれについての洞察を持っていますか?

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鉛フリーの問題はいつですか?
コンポーネントを購入するとき、鉛フリーまたはRoHS準拠の部品を、そうでない部品と一緒に見つけるのが一般的です。鉛フリーまたはRoHS(または他の鉛フリーの指定が存在する)部品のみを選択したことは、どのような状況で重要ですか?安価な非鉛フリー部品よりも鉛フリー部品を選ぶ動機は何ですか? 補足として、このすべての鉛フリービジネスが何であるかについてのいくつかの説明は私にとって興味深いでしょう。

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PCBの両側にコンポーネントを取り付ける
私は、マイクロコントローラー、CANトランシーバー、センサー(I2C)およびリニアレギュレーターを使用してPCBを設計しています。PCBを可能な限り小さくしたいので、私の考えは2層スタックの両面を使用することでした。私はこれをこれまで一度もやったことがなく、ボードの片側だけをコンポーネントに使用していました。 私の主な関心事は、背中合わせに何を避けるべきですか?たとえば、リニアレギュレータをマイクロコントローラのすぐ後ろに配置するのは適切ではないという経験に基づいた推測をします。 通信回線(I2C UART CAN)のクロスオーバーを避ける必要がありますか?

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メーカーは、コンポーネントをできるだけ理想的なコンポーネントに近づけようとしていますか?
今日、電気部品の開発はどうなっているのだろうと思っていました。 メーカーは、販売する電気部品をできるだけ理想的なモデルに近づけようとしていますか?たとえば、固定抵抗器の目標は、最も広い範囲の電圧値と周波数に対してオームの法則に従って動作することですか?または、いくつかのユースケースで理想的なモデルとは異なる非線形動作に利点がありますか?

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偽造コンポーネントを想定できますか?
私は最近、中国のメーカーから10個のPCBを受け取ったが、角を切って偽造部品を調達し始めているのではないかと心配している。その理由は次のとおりです。 完全なターンキー生産(PCB Fab、部品調達、組立)を行わせました。私は過去にそれらを使用しましたが、時折間違いはありましたが、かなり良いものでした。 4/10ボードで、下の回路が期待どおりに動作しないことに気付きました。 この回路のシミュレーション – CircuitLabを使用して作成された回路図 障害のあるボードでは、Q3 + Q5のゲート電圧が〜0 V(NOR出力= 1(5V)の場合)または〜12 V(NOR出力= 0(GND)の場合)になると予想されますが、ゲート電圧は3-7 Vのどこからでも... ここに私が部品に疑いを持つ理由があります: 同じメーカーで以前のPCBの繰り返しでこの回路を使用しましたが、この問題は発生していません。変更のみがPCBレイアウトのわずかな違いです。 Q1、Q3、Q5を手作業で取り外し、Digikeyの部品と交換した後、回路は期待どおりに機能します。これを3つのボードで実行し、3つすべてが非稼働から稼働に移行しました。 関連するNPN + PMOSの部品番号を以下に示します。ここにデータシートのリンクがあります: DMP3010 MBT2222 あるいは、回路に根本的な問題があると思われる場合、私はすべて耳にします。しかし、それは非常に一般的で単純な回路であり、前述のように、以前の反復で問題なく使用したものです。

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マイクロチップの周りの保護層は何ですか?
私はただ興味があります。すべてのマイクロチップが作られているように見える、暗い、ほとんど黒い材料は何ですか?私はGoogleで検索して調べてみましたが、チップの内部の材料であるシリコンしか見つけられなかったようです。とにかく、完全なチップがシリコンで作られていないのはかなり確実です。 ありがとう!

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コネクタの「ピックアンドプレース」機能
4ピン、1.0 mmピッチの垂直JSTコネクタ(BM04B-SRSS-TB(LF)(SN)またはBM04B-SRSS-TBT(LF)(SN)のいずれかをソースとして使用することを検討しています。後者には、Digikeyに追加の「ピックアンドプレイス」機能があります。JSTのパーツのデータシートには情報がありません。また、インターウェブにも情報がありません。パーツ間にはUS $ 0.18のコストの違いがあります(追加機能のコストが高くなるのは当然ですが)。 この機能は具体的には何ですか?この機能のないコネクタをピックアンドプレース製造で引き続き使用できますか?

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カットテープから部品を巻き取る方法は?
Digi-KeyはどのようにしてDigi-Reelsを作成しますか(または、MouserがMouser-Reelsなどを作成しますか)?つまり、カットテープ形式のパーツが与えられた場合、テープフィーダーへのスプールをサポートするリーダーを追加するには、どのツールと追加の材料が必要ですか?下の写真は、接合部を通してピッチを一定に保つような方法でリーダーをカットテープに接着するある種の箔を示しています。ディストリビューターにリール料金を支払う代わりに、自分でこれを行うことはもっともらしい/費用効果的ですか?

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合成されたROMコアを使用した単純なテストベンチのシミュレーション
私はFPGAの世界にまったく新しいので、4ビットの7セグメントデコーダーという非常に単純なプロジェクトから始めようと思いました。私が純粋にVHDLで書いた最初のバージョン(それは基本的に単一の組み合わせselectであり、クロックは必要ありません)は機能しているようですが、ザイリンクスISEの「IPコア」の要素を試してみたいと思います。 今のところ、「ISE Project Explorer」GUIを使用しており、ROMコアを使用して新しいプロジェクトを作成しました。生成されるVHDLコードは次のとおりです。 LIBRARY ieee; USE ieee.std_logic_1164.ALL; -- synthesis translate_off LIBRARY XilinxCoreLib; -- synthesis translate_on ENTITY SSROM IS PORT ( clka : IN STD_LOGIC; addra : IN STD_LOGIC_VECTOR(3 DOWNTO 0); douta : OUT STD_LOGIC_VECTOR(6 DOWNTO 0) ); END SSROM; ARCHITECTURE SSROM_a OF SSROM IS -- synthesis translate_off COMPONENT wrapped_SSROM …

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