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Intel 8080は、エンハンスメントモードNMOSプロセスを使用して製造された1974年にリリースされた古典的なマイクロプロセッサであり、2フェーズクロックと3つの電源レールの要件など、このプロセスに関連するさまざまな固有の特性を示します：-5 V、 +5 V、および+12V。 では、電源ピンの説明ウィキペディアから、それは言います ピン2：GND（V SS）-グランド ピン11：-5 V（V BB）--5 V電源。これは最初に接続され、最後に切断された電源でなければなりません。そうしないと、プロセッサが損傷します。 ピン20：+5 V（V CC）-+ 5 V電源。 ピン28：+12 V（V DD）-+12 V電源。これは、最後に接続され、最初に切断された電源でなければなりません。 元のデータシートを相互参照しましたが、情報は少し矛盾しています。 絶対最大値： V BB（-5 V）に対するV CC（+5 V）、V DD（+12 V）、およびV SS（GND ）：-0.3 V〜+20 V 接続されていないときにV BBが0 Vであっても、V DDは+17 Vであり、絶対最大値を超えてはなりません。-5 Vが正しくないうちに+12 Vが接続されると、Intel 8080チップが破壊されるというのは、Wikipediaの最初の主張ですか？ それが正しい場合、これを行う場合の正確な障害メカニズムは何ですか？-5 Vなしで最初に+12 Vを印加すると、チップが破壊されるのはなぜですか？エンハンスメントモードのNMOSプロセスと関係があるのではないかと思いますが、半導体がどのように機能するかはわかりません。 Intel 8080の内部で電源がどのように実装されているか説明していただけますか？同様のプロセスを使用して構築された同じ時代の他のチップ間に問題が存在しましたか？ また、Intel 8080用の電源を設計する必要がある場合、たとえば3つの電圧レギュレータを使用する場合、-5 Vの前に+12 …

27 power-supply  integrated-circuit  semiconductors  nmos  8080 

古いPMOS / NMOSロジックに+ 5、-5、+ 12ボルトなどの複数の電圧が必要なのはなぜですか？たとえば、古いIntel 8080プロセッサ、古いDRAMなど。 物理/レイアウトレベルの原因に興味があります。これらの追加電圧の目的は何ですか？ はい、この質問は35年前に使用されたものに関するものです。

26 voltage  digital-logic  nmos  pmos  history 

NMOSでは、電流はソースからドレインへ、またはその逆に流れますか？ このウィキペディアのページは私を混乱させています：http : //en.wikipedia.org/wiki/MOSFET 上記の画像は私を混乱させます。Nチャンネルの場合、ダイオードの極性が一部のソースに向かっていますが、他のソースからは離れています。 どの端子を電源に接続する必要があるのか​​（つまり、正のバッテリー端子）、どの端子をパワーユーザーに接続するのか（つまり、電動機）を考えています。

23 mosfet  nmos  polarity 

学校では、PMOSトランジスタとNMOSトランジスタ、およびエンハンスメントモードとデプレッションモードのトランジスタについて学びました。これが私が理解しているものの短いバージョンです： 拡張とは、チャネルが通常閉じていることを意味します。枯渇とは、チャネルが通常開いていることを意味します。 NMOSは、チャネルが自由電子でできていることを意味します。PMOSは、チャネルがフリーホールでできていることを意味します。 エンハンスメントNMOS：正のゲート電圧は電子を引き付け、チャネルを開きます。 エンハンスメントPMOS：負のゲート電圧はホールを引き付け、チャネルを開きます。 空乏型NMOS：負のゲート電圧が電子を反発し、チャネルを閉じます。 空乏型PMOS：正のゲート電圧がホールを反発し、チャネルを閉じます。 私が生活のための設計作業を始めてから6年が経過し、少なくとも1つの機会に空乏型PMOSトランジスタが欲しかった（または少なくとも欲しかったと思った）。たとえば、電源のブートストラップ回路には良い考えのように思えました。しかし、そのようなデバイスは存在しないようです。 空乏型PMOSトランジスタがないのはなぜですか？それらについての私の理解は欠陥がありますか？彼らは役に立たないのですか？構築できませんか？構築するのに非常に高価なので、他のトランジスタのより安い組み合わせが好まれますか？それとも彼らはそこにいて、私はどこを見ればいいのか分かりませんか？

11 transistors  components  nmos  semiconductors  pmos 

PMOSの出力は次のとおりです。 I/P O/P 0 1 1 0 反転ロジックにCMOSを使用する代わりに、これを使用できないのはなぜですか？ （私はこのトピックと主題の初心者なので、簡単な言葉で説明してください）

8 mosfet  digital-logic  cmos  nmos  pmos 

宿題があります。助けが必要です。 私は、DCバイアスの計算を正しく行っているかどうかを誰かが教えてくれるかどうかを知りたかったのですが、正しくない場合、誰かが私を正しい方向に動かしてくれませんか？ 私はAC分析について話しているのではなく、DCについてのみ説明しています。 ここに質問があります ここに私の試みがあります

8 bjt  nmos