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コンピュータアーキテクチャとは、互換性、パフォーマンス、およびインターフェイスに影響を与える可能性のあるコンピュータシステム設計のさまざまな側面を指します。コンピュータアーキテクチャに関連するいくつかの問題は、プロセッサのワードサイズ、メモリバスサイズ、またはプロトコルの実装です。



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ハードディスクブロックモデルの読み取り時間の計算
私の教授は、ブロックモデルを使用してハードディスクからのデータ取得を計算する方法についてのスライドを投稿しました。仕様は次のとおりです。 7200 RPM 5msシーク 80MB /秒の転送速度 ブロックモデル:ブロックサイズ4KB 私は彼が次の計算をどのようにしたのか、またはいくつかの数字がどこから来たのかわかりません: ブロックを読み取るための5ms + 1000/240 ms + 0.05ms = 9.216ms 1000/240 msと0.05msはどこから来たのですか? 編集:数字が完全に間違っている場合、どのようにこれを行いますか?

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PCIeデバイスがレーンを共有できないのはなぜですか?
古いチップセットでは、PEGスロットに専用のグラフィックスカードを装着し、同時にIntegrated Graphics Device(IGD)を有効にすることは不可能でした。 オンラインで調べた後、私はこれがどちらか一方であり、BIOSがPEGスロットでカードを検出した場合にIGDを無効にするので、同じバスレーンを共有していたことが原因であることがわかりました。 PCIeデバイスが同じレーンを共有できないのはなぜだろうと思いました。古いPCI規格ではすべてのデバイスが同じレーンを共有していたのですが、PCIeではこれが不可能なのはなぜでしょうか。 PCIeはシリアルでスイッチと「エンドデバイス」の間にポイントツーポイント接続を確立しますが、IGDと専用カードが同じレーンを共有している場合、なぜそれらが連携できないのか理解できません。 PCIeデザインのどの部分がこれを防ぎますか? ありがとう。


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ALUはすべての命令に使用されていますか?
フォン・ノイマン・アーキテクチャーに関するウィキペディアのページにこの写真があります。同様の写真がたくさんあります。(Von Neumann Architectureに関する多くの記事でも、ALUだけがプログラムを実行します。)ALU(I / O)には2つの矢印があり、I / Oには矢印がありません。コントロールユニットへ。(一部の写真には、メモリからALUへのデータバスのみを表す矢印があります)。これは私を混乱させます。CPUには命令をフェッチするコントロールユニットがあり、そのリソースを使用して実行することを理解しています。そのため、たとえば、ある場所から別の場所にデータをコピーするだけの命令(mov)、またはCPUに命令ポインターを特定の値(jmp)に設定させる命令、またはIRQがある場合、ALUは使用されません。フォンノイマンアーキテクチャは、数学演算のみを実行するコンピューターでのみ適用されたため、入力と出力は両方とも数字のみを表していたと思います。入力はメモリを変更できませんでした(ALUにのみ接続されていたため)。そのため、最新のコンピューターアーキテクチャは、命令とデータが同じメモリに格納され、CPUにはコントロールユニット、一部のレジスター、ALUが含まれることのみが継承されます(これも基本的なもので、最新のCPUにはこれ以上のものが含まれます)。私は正しいですか?

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プロセッサとメモリ/キャッシュ間の物理的な距離はデータ転送速度にどのように影響しますか
L1キャッシュはCPU内にあり、データアクセスプロセスを高速化しますが、電気信号は非常に速い光の速度(ほぼ一定)で移動するため、距離はどのように考慮されますか。光が10 cmの距離に対して2 cmの距離を移動することはたいしたことではなく、両方のポイントに到達するのにかかる時間はほとんど同じです。 CPUは、CPUがより速くアクセスできます。もう1つの質問は、CPUのクロック速度とは何か、そしてそれがデータ転送速度にどのように影響するかということです。

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32ビットシステムの最大RAMサイズ[複製]
この質問にはすでに答えがあります: Windowsに4 GBのRAMのうち約3.5 GBしか表示されないのはなぜですか? 9つの答え 32ビットシステムでは、RAM内のメモリセルの最大数は2 ^ 32であることを知っています。しかし、私のコンピューターのRAMは正確にこのサイズを示していません。誰かがRAMの32ビットシステムサイズでセルの最大サイズと等しくないが異なる(3.2-3.6 Gb)理由を説明できますか?
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