業界でNANDゲートがNORゲートよりも好ましいのはなぜですか?


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多くの場所で、業界ではNANDゲートがNORゲートよりも好ましいと読んでいます。オンラインで与えられた理由は言う:

NANDは、NOR PMOS(サイズ2および並列)により、NOR PMOS(サイズ4の直列)と比較して、Norよりも遅延が小さくなっています。

私の理解によると、遅延は同じだろう。これは私がそれがどのように働くと思うかです:

  • 絶対遅延(Dabs)= t(gh + p)
  • g =論理的努力
  • h =電気的努力
  • p =寄生遅延
  • t =技術定数である遅延単位

NANDおよびNORゲートの場合(gh + p)は(Cout / 3 + 2)になります。また、tは両方とも同じです。それから遅延は同じ権利であるべきですか?


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同じ駆動能力を持つ「NOR」ゲートを作成するために、2倍の大きさのトランジスタを使用する必要がある場合、それらのトランジスタのゲート容量はどういう意味になり、速度にどのように影響しますか?
supercat

少なくともHCの家族のために、TIリスト、同一の伝播遅延を74HC00(NAND)74HC02(NOR)
tcrosley

@placeholder私の(今)削除された回答に対するコメントの説明をありがとう。OPはICの内部設計を指しており、ロジック設計者がどちらか一方を使用することを好みませんが、これは私が誤って言っていたものです。
tcrosley

@tcrosleyは問題ではありません。問題に答える準備ができていると思いますか?
プレースホルダー

回答:


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1. NANDは遅延が少ない。

あなたが言っていたように、遅延の方程式は ですが、NANDの 論理的努力gはNORのそれよりも小さくなります。2入力CMOS NANDおよびNORゲートを示す図を検討してください。各トランジスタに対する数はサイズの測定値であり、したがって静電容量です。

Delay=tgh+p
gここに画像の説明を入力してください

論理的努力はとして計算できます。それは与えるg=Cn/3

  • g=4/3g=n+23
  • g=5/3g=2n+13
  • 表についてはwikiを参照してください。

h=1p=2

編集:私はさらに2つのポイントを持っていますが、最後のポイントについて100%確信はありません。

2. NORはより多くの領域を占有します。

図にトランジスタのサイズを追加すると、NORのサイズがNANDのサイズよりも大きいことが明らかです。また、このサイズの違いは、入力の数が増えるにつれて大きくなります。

NORゲートは、NANDゲートよりも多くのシリコン領域を占有します。

3. NANDは同様のサイズのトランジスタを使用します。

再び図を考えると、NANDゲートではそうではないが、NANDゲートのトランジスタはすべて同じサイズです。NANDゲートの製造コストを削減します。より多くの入力を備えたゲートを検討する場合、NORゲートには2つの異なるサイズのトランジスタが必要であり、NANDゲートと比較するとサイズの差が大きくなります。


3番目のコメントは、2番目のコメントの単なる再表示です。
プレースホルダー

@placeholderよくわかりません。このように考えてください:私の回路は「2入力NANDのみ」または「2入力NORのみ」として実装できると仮定します。レイアウトマスクを設計するとき、トランジスタの寸法が同じであれば簡単です。「コピー貼り付け」(またはそのようなもの)でマスクを作成できます。時間と労力、したがってコストを削減できます。間違っている場合は修正してください。
nidhin

最初の回答では、2つの入力ゲートg(NAND)= 4/3およびg(NOR)= 5/3について言いました。ただし、h(NAND)= Cout / Cin = Cout / 4およびh(NOR)= Cout / 5。また、P(NANDおよびNOR)= Cpt / Cinv = 6/3 = 2。d(NAND、NOR)= gh + p =(Cout / 3)+2 ..
好奇心が強い

ああ、私は今それを得る。1つのnandを別のh = 1で駆動し、同様に別のnandもh = 1を駆動する場合。そうすると、nandの遅延は10/3になり、また11/3にもなりません。トンありがとう:)
好奇心が強い

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大まかに言えば、Nmosトランジスターは、Pmosトランジスターと比較して、チャネル面積あたりの電流が2倍になります。Nmosの抵抗は、同じサイズのPmosの半分であると考えることができます。Cmos Nandトポロジは、ここからわかるように、トランジスタのサイズをより等しくすることに役立ちます。
ここに画像の説明を入力してください

いずれかの入力が低い場合、単一のPmos抵抗が出力を高く駆動します。両方の入力が高い場合、2 Nmosの抵抗があります(〜= 1 Pmosの抵抗)。すべてのトランジスタがテクノロジーノードの同じ最小サイズである場合、このトポロジは理想的です。なぜなら、出力をハイまたはローで駆動していても、グランドまたはVddへの抵抗は同じだからです。

最後に、PmosトランジスタがNmosのトランジスタと比べて公平ではない理由は、PMOSの大半のキャリアであるホールのキャリア移動度が低いためです。Nmosの多数キャリアは、移動度が大幅に向上した電子です。

また、Nand FlashとNand Cmosを混同しないでください。Nand Flashメモリも一般的ですが、それはさまざまな理由によるものです。


相対負荷(ゲート面積)と相対相互コンダクタンス、したがって速度g_m / Cについて話すと、答えが改善されると思います。
プレースホルダー
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